SynaptiCAD Product Suite v15.00i LINUX
SynaptiCADProductSuitev15.00iLINUX英文正式版(電子設計自動化軟體)
破解說明:
關掉主程式,破解檔放置於crack夾內,請將破解檔複製於主程式的安裝目錄內既可破解
內容說明:
SynaptiCAD公司出品的EDA(電子設計自動化)工具集合,包括HDL輸入、仿真、測試、波形分
析、管腳映射工具等等,是一個很完整的EDA方案。
包含了9種功能強大的工具:TestBencherPro;BugHunterPro;VeriLoggerPro;WaveFormer
Pro;SimuTAG;PinPort;DataSheetPro;TimingDiagrammerPro;GigawaveViewer。
1.TestBencherPro:用於從獨立於語言的時序邏輯表生成交互式VHDL,Verilog,OpenVera,e,
和TestBuilder測試基準及總線功能的模型。生成的測試基準能提供基於仿真相應的不同的激
發向量,以便於測試基準功能作為一個被測試系統環境的動作模型正常工作。TestBencher
Pro是一個優秀的測試大規模FPGA和ASIC設計的工具。
2.BugHunterPro:一款用於Verilog,VHDL和C++模擬器的圖形調試系統。BugHunter支
援所有主要的HDL模擬器,其主要功能包括:單一步驟調試、波形數據串流、項目管理等等。
可以偵測程式與幫助系統的交互過程從而發現問題所在。
3.VeriLoggerPro:Verilog模擬器軟體。提供一個綜合了傳統Verilog模擬器所有特徵的仿真
環境,它具有強大的圖形測試向量產生器。VeriLogger的快速模型測試使用戶可以對設計中的
每個模型進行「自底向上」的測試。
4.WaveFormerPro:由時序圖分析器、模擬器和測試向量生成器組合而成。它為設計人員提供
了一個集成的環境,可以用來開發數字和模擬線路的時序圖。WaveFormerPro可以由Spice模
擬器,Mathematica,或Matlab等工具輸入模擬數據。還可以利用WaveFormerPro內部擁有的
波形函數直接生成模擬信號;或者將從總線上得到的數字信號變換成模擬信號。還可以將模擬
信號波形逐段線性地變換成Spice模擬器的電壓信號源。
5.SimuTAG:一款功能強大和實時地查證出FPGAs的錯誤的系統。可經由比較FPGA功能規則反
證RTL樣式模擬規則,迅速發現邏輯和綜合錯誤。
6.PinPort:提供數字硬體與Verilog或C++的虛擬介面環境。
7.DataSheetPro:時間表文件夾管理工具。
8.TimingDiagrammerPro:時間表設計工具。
9.GigawaveViewer:波形觀測器。
英文說明:
Wantapowerful,yeteasytousesimulationenvironment?
SynaptiCAD'ssimulationanddebuggingtoolsprovidea
standardinterfaceforcontrollingallofyoursimulation
tools.SynaptiCAD'stimingdiagrameditorshavethemost
extensiveandaccuratetiminganalysisfeaturesavailable
inanytimingdiagrameditoronthemarketincludingdelay
correlation,reconvergentfan-out,andclocksthatmodel
jitterandbufferdelays.Threedifferentlevelsofediting
letyoupickthebestpriceandfeaturesetforyour
application.Freeyourselffromthetime-consumingprocess
ofmanuallywritingVerilog,VHDL,andSystemCtestbenches.
Generatethemgraphicallyfromtimingdiagrams.SynaptiCAD
provides3levelsoftestbenchgenerationtomeetallyour
designneeds.SynaptiCADofferssupportforthelatesttest
equipmentandemulationtechnologiesallowingyoutoport
yoursimulationandtiminganalysisdatatoyour
prototypingenvironment.
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